图书介绍
Cadence高速电路板设计与仿真 第2版pdf电子书版本下载
- 周润景，袁伟亭编著 著
- 出版社： 北京：电子工业出版社
- ISBN：7121048302
- 出版时间：2007
- 标注页数：739页
- 文件大小：148MB
- 文件页数：756页
- 主题词：电路设计－计算机仿真
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图书目录
第1章 Cadence Allegro SPB 15.7简介 1
1.1 概述 2
1.2 功能特点 2
1.2.1 功能模块 2
1.2.2 特有功能 4
1.3 设计流程 4
1.3.1 前处理 5
1.3.2 中处理 5
1.3.3 后处理 6
1.4 Cadence Allegro SPB 15.7新功能介绍 6
1.4.1 平面层新功能 6
1.4.2 ROOM新增的3个参数 8
1.4.3 使用ALT_SYMBOLS_HARD属性来限制元器件布局 9
1.4.4 动态Shape 9
1.4.5 保持过孔的网络属性 9
1.4.6 设定自动保存的文件数量 10
1.4.7 分析功能 10
1.4.8 Soldermask的检查 10
1.4.9 Backdrilling功能 11
1.4.10 NC Drill支持Build-up技术 14
1.4.11 NC Ledgend增强 14
1.4.12 Artwork新功能 15
1.4.13 新命令 16
1.4.14 OrCAD Layout设计转换为Allegro PCB Editor设计 16
第2章 Capture原理图设计工作平台 17
2.1 Design Entry CIS软件功能介绍 18
2.2 原理图工作环境 18
2.3 设置图纸参数 19
2.3.1 设置颜色 20
2.3.2 设置格点属性 21
2.3.3 杂项的设置 22
2.3.4 设置其他参数 22
2.4 设置设计模板 23
2.4.1 字体设置 23
2.4.2 标题栏（Title Block）设置 24
2.4.3 页面尺寸（Page Size）设置 24
2.4.4 格点参数（Grid Reference）设置 25
2.4.5 设置层次图参数 26
2.4.6 设置SDT兼容性 27
2.5 设置打印属性 27
第3章 制作元件及创建元件库 31
3.1 创建单个元件 32
3.1.1 直接新建元件 33
3.1.2 用电子表格新建元件 41
3.2 创建复合封装元件 44
3.2.1 创建U?A 44
3.2.2 创建U?B、U?C和U?D 45
3.3 大元件的分割 46
3.4 创建其他元件 47
习题 48
第4章 创建新设计 49
4.1 原理图设计规范 50
4.2 Capture基本名词术语 50
4.3 建立新项目 52
4.4 放置元件 53
4.4.1 放置基本元件 54
4.4.2 对元件的基本操作 56
4.4.3 放置电源和接地符号 57
4.4.4 完成元件放置 58
4.5 创建分级模块 59
4.5.1 创建简单层次式电路 59
4.5.2 创建复合层次式电路 65
4.6 修改元件序号与元件值 68
4.7 连接电路图 69
4.7.1 导线的连接 69
4.7.2 总线的连接 70
4.7.3 线路示意 72
4.8 标题栏的处理 74
4.9 添加文本和图像 75
4.10 建立压缩文档 76
4.11 平坦式和层次式电路图设计 77
4.11.1 平坦式和层次式电路特点 77
4.11.2 电路图的连接 79
习题 80
第5章 PCB设计预处理 83
5.1 编辑元件的属性 84
5.1.1 编辑元件属性的两种方法 84
5.1.2 指定元件封装 86
5.1.3 参数整体赋值 86
5.1.4 分类属性编辑 88
5.1.5 定义ROOM属性 89
5.1.6 定义按页摆放属性 90
5.2 Capture到Allegro PCB Editor的信号属性分配 93
5.2.1 为网络分配PROPAGATION_DELAY属性 94
5.2.2 为网络分配RELATIVE_PROPAGATION_DELAY属性 96
5.2.3 为网络分配RATSNEST_SCHEDULE属性 97
5.2.4 输出新增属性 98
5.3 建立差分对 98
5.3.1 为两个Flat网络建立差分对（手动建立差分对） 98
5.3.2 为一个设计中多对Flat网络同时建立差分对（自动建立差分对） 100
5.4 Capture中总线（Bus）的应用 101
5.4.1 平坦式电路图设计中总线的应用 101
5.4.2 层次式电路图设计中总线的应用 105
5.5 原理图绘制后续处理 109
5.5.1 设计规则检查 109
5.5.2 为元件自动编号 114
5.5.3 回注（Back Annotation） 115
5.5.4 自动更新元件或网络的属性 116
5.5.5 生成网络表 117
5.5.6 生成元件清单 120
5.5.7 属性参数的输出／输入 122
习题 124
第6章 Allegro的属性设置 125
6.1 Allegro的界面介绍 126
6.2 设置工具栏 132
6.3 定制Allegro环境 133
6.3.1 设定绘图参数 134
6.3.2 设置文字尺寸 140
6.3.3 设置格点 141
6.3.4 设置Subclasses选项 141
6.3.5 设置B/B Via 142
6.3.6 电路板的预览功能 144
6.3.7 打印设置 144
6.3.8 设置自动保存功能 146
6.4 编辑窗口控制 147
6.4.1 鼠标按键功能 147
6.4.2 画面控制 147
6.4.3 使用Strokes 148
6.4.4 设置快捷键 150
6.4.5 控制面板位置设置 151
6.4.6 定义和运行脚本 151
习题 156
第7章 集成电路封装的制作 157
7.1 基本概念 158
7.2 集成电路封装（IC）的制作 159
7.2.1 利用向导制作DIP24封装 159
7.2.2 手工制作SOIC20封装 172
第8章 连接器和分立元件封装的制作 181
8.1 连接器（IO）封装的制作 182
8.1.1 标准热风焊盘的制作 182
8.1.2 非标准热风焊盘的制作 183
8.1.3 制作焊盘 185
8.1.4 制作DIN64的封装 189
8.2 分立元件（DISCRETE）封装的制作 195
8.2.1 贴片的分立元件封装的制作 195
8.2.2 直插的分立元件封装的制作 201
习题 205
第9章 电路板的建立 207
9.1 建立电路板 208
9.1.1 使用电路板向导（Board Wizard）建立电路板 208
9.1.2 手工建立电路板 213
9.1.3 建立电路板机械符号 218
9.1.4 建立Demo设计文件 226
9.2 输入网络表 232
习题 235
第10章 设置设计规则 237
10.1 设置标准设计规则 238
10.2 设置扩展设计规则 239
10.2.1 间距规则设置 239
10.2.2 物理规则设置 243
10.3 设定设计约束（Design Constraints） 245
10.4 设置元件属性 246
10.4.1 为元件添加属性 246
10.4.2 为元件添加FIXED属性 247
10.4.3 为元件添加Room属性 247
10.4.4 为网络添加属性 249
10.4.5 显示属性和元素 249
10.4.6 删除属性 251
习题 252
第11章 布局 253
11.1 规划电路板 255
11.1.1 设置格点 255
11.1.2 添加ROOM 255
11.1.3 为预摆放封装分配元件序号 258
11.2 手工摆放元件 259
11.2.1 按照元件序号摆放 259
11.2.2 高亮GND和VCC网络 260
11.2.3 改变元件默认方向 261
11.2.4 移动元件 262
11.3 快速摆放元件 263
11.3.1 快速摆放元件到分配的Room中 263
11.3.2 快速摆放剩余的器件 265
11.3.3 产生报告 267
习题 271
第12章 高级布局 273
12.1 显示飞线 274
12.2 交换 275
12.2.1 功能交换 275
12.2.2 管脚交换 277
12.2.3 元件交换 278
12.2.4 自动交换 279
12.3 使用ALT_SYMBOLS属性摆放 280
12.4 按Capture原理图页进行摆放 282
12.5 原理图与Allegro交互摆放 286
12.5.1 原理图与Allegro交互设置方法 286
12.5.2 Capture和Allegro交互选择 286
12.5.3 Capture与Allegro交互高亮和反高亮元件 287
12.5.4 Capture与Allegro交互高亮和反高亮网络 289
12.6 自动布局 291
12.6.1 设置布局的网格 291
12.6.2 设置元件进行自动布局的属性 293
12.6.3 元件的自动布局 294
习题 297
第13章 铺铜 299
13.1 基本概念 300
13.1.1 正片和负片 300
13.1.2 动态铜箔和静态铜箔 301
13.2 为平面层建立Shape 302
13.2.1 显示平面层 302
13.2.2 为VCC电源层建立Shape 302
13.2.3 为GND地层建立Shape 303
13.3 分割平面 304
13.3.1 使用Anti Etch分割平面 304
13.3.2 使用添加多边形的方法分割平面 307
13.4 分割复杂平面 318
13.4.1 定义复杂平面并输出底片 318
13.4.2 添加负平面Shape并进行负平面孤铜检查 320
习题 322
第14章 布线 323
14.1 布线的基本原则 324
14.2 布线的相关命令 325
14.3 定义布线的格点 325
14.4 手工布线 327
14.4.1 添加连接线 327
14.4.2 删除布线 328
14.4.3 添加过孔 329
14.4.4 使用Bubble选项布线 331
14.5 扇出（Fanout By Pick） 331
14.6 群组布线 333
14.7 自动布线的准备工作 335
14.7.1 浏览前面的设计过程中定义的规则 335
14.7.2 在指定层布地址线的规则设置 336
14.7.3 设定电气规则 338
14.7.4 设置特殊规则区域 341
14.8 自动布线 344
14.8.1 使用Auto Router自动布线 344
14.8.2 使用CCT布线器自动布线 351
14.8.3 对指定网络或元件布线（Route Net(s)by Pick） 354
14.9 控制并编辑线 356
14.9.1 控制线的长度 356
14.9.2 差分布线 364
14.9.3 高速网络布线 377
14.9.4 45°角布线调整（Miter By Pick） 380
14.9.5 改善布线的连接 382
14.10 优化布线（Gloss） 387
14.10.1 固定关键网络 387
14.10.2 Gloss参数设置 388
14.10.3 添加和删除泪滴 390
14.10.4 自定义平滑（Custom Smooth）布线 391
习题 393
第15章 后处理 395
15.1 重命名元件序号 396
15.1.1 自动重命名元件序号 396
15.1.2 手动重命名元件序号 399
15.2 文字面调整 399
15.2.1 修改文字面字体大小 399
15.2.2 改变文字的位置和角度 400
15.2.3 调整Room的字体 401
15.3 回注（Back Annotation） 402
习题 404
第16章 加入测试点 405
16.1 产生测试点 406
16.1.1 自动加入测试点 406
16.1.2 建立测试夹具的钻孔文件 410
16.2 修改测试点 411
16.2.1 手动添加测试点 411
16.2.2 手动删除测试点 412
16.2.3 交换测试点 413
16.2.4 重新产生log文件、钻孔数据和报告 413
16.2.5 建立测试夹具 415
习题 416
第17章 电路板加工前的准备工作 417
17.1 建立丝印层 418
17.1.1 设置层面颜色和可视性 418
17.1.2 自动添加丝印层 418
17.2 建立报告 421
17.3 建立Artwork文件 422
17.3.1 设置加工文件参数 424
17.3.2 设置底片控制文件 427
17.3.3 建立Assembly底片文件 428
17.3.4 建立Soldermask底片文件 430
17.3.5 建立Pastemask底片文件 433
17.3.6 运行DRC检查 435
17.4 建立钻孔图 435
17.4.1 颜色与可视性设置 435
17.4.2 建立钻孔符号和图例 436
17.5 建立钻孔文件 438
17.6 输出底片文件 440
17.6.1 建立钻孔图例的底片文件 440
17.6.2 输出底片文件 442
17.7 浏览Gerber文件 443
17.7.1 为底片建立一个新的Subclass 443
17.7.2 加载Artwork文件到PCB编辑器 444
第18章 Allegro其他高级功能 447
18.1 设置过孔的焊盘 448
18.2 更新元件封装符号 449
18.3 Net和Xnet 450
18.4 技术文件的处理 451
18.4.1 输出技术文件 451
18.4.2 输入技术文件到新设计中 452
18.4.3 比较技术文件 454
18.5 设计重用 456
18.6 DFA检查 463
18.7 修改env文件 465
18.8 Skill的程序安装及功能说明 466
18.8.1 Skill程序安装 466
18.8.2 Skill功能说明 468
习题 469
第19章 高速PCB设计知识 471
19.1 高速PCB的基本概念 472
19.1.1 电子系统设计所面临的挑战 472
19.1.2 高速电路的定义 472
19.1.3 高速信号的确定 472
19.1.4 传输线 473
19.1.5 传输线效应 473
19.2 PCB设计前的准备工作 474
19.2.1 设计前的准备工作 474
19.2.2 电路板的层叠 474
19.2.3 串扰和阻抗控制 475
19.2.4 重要的高速结点 475
19.2.5 技术选择 475
19.2.6 预布线阶段 475
19.2.7 避免传输线效应的方法 476
19.3 高速PCB布线 478
19.3.1 高速PCB信号线的布线基本原则 478
19.3.2 地线设计 478
19.4 布线后信号完整性仿真 479
19.4.1 布线后信号完整性仿真的意义 479
19.4.2 模型的选择 479
19.5 提高抗电磁干扰能力的措施 479
19.5.1 需要特别注意抗电磁干扰的系统 479
19.5.2 应采取的抗干扰措施 480
19.6 测试与比较 481
第20章 仿真前的准备工作 483
20.1 IBIS模型 484
20.1.1 IBIS模型与SPICE模型的特点 484
20.1.2 IBIS模型的物理描述 485
20.2 验证IBIS模型 486
20.2.1 浏览解析的IBIS文件结果 486
20.2.2 在Model Integrity中仿真IOCell模型 492
20.2.3 使用IBIS to DML转换器 493
20.2.4 浏览DML文件的错误和警告信息 494
20.2.5 使用Espice to Spice转换器 495
20.3 预布局 499
20.4 电路板设置要求（Setup Advisor） 503
20.4.1 叠层设置 503
20.4.2 设置DC电压值 506
20.4.3 器件设置（Device Setup） 507
20.4.4 SI模型分配 509
20.4.5 SI检查（SI Audit） 516
20.5 基本的PCB SI功能 517
20.5.1 设置显示内容 517
20.5.2 显示网络飞线 518
20.5.3 确定HA3网络的元件 518
20.5.4 摆放元件于板框内 519
习题 520
第21章 约束驱动布局 521
21.1 预布局拓扑提取和仿真 522
21.1.1 预布局拓扑提取的设置 522
21.1.2 预布局拓扑提取分析 524
21.1.3 执行反射仿真 528
21.1.4 反射仿真测量 534
21.2 前仿真时序 546
21.2.1 时序信号简介 546
21.2.2 时序计算 550
21.2.3 运行参数扫描 553
21.2.4 为拓扑添加约束 560
21.2.5 分析拓扑约束 565
21.3 模板应用和约束驱动布局 567
21.3.1 为串扰仿真建立拓扑 569
21.3.2 执行串扰仿真 581
21.3.3 应用电气约束规则 586
21.3.4 解决DRC错误 590
习题 595
第22章 约束驱动布线 597
22.1 手工布线 598
22.1.1 手工为HA4网络布线 598
22.1.2 布线后调整 606
22.2 自动布线 608
22.2.1 为HA4和HA9网络自动布线 608
22.2.2 检查已布线的网络 611
22.2.3 使用Automatic Router自动布线 619
22.3 分析布线网络的拓扑 621
22.3.1 设置分析参数 621
22.3.2 仿真分析 625
习题 630
第23章 后布线DRC分析 631
23.1 更新拓扑模板 632
23.1.1 获取DRC错误信息 632
23.1.2 修改模板的参数 634
23.1.3 更新拓扑 638
23.2 后仿真 640
23.2.1 反射仿真 640
23.2.2 综合仿真 648
23.2.3 串扰仿真 650
23.2.4 Simultaneous Switching Noise仿真 653
23.3 多板仿真 665
23.3.1 多板建模 665
23.3.2 使用DesignLink分析反射 671
习题 676
第24章 差分对设计 677
24.1 建立差分对 678
24.1.1 手工建立差分对 678
24.1.2 自动建立差分对 679
24.2 仿真前准备工作 681
24.2.1 阻抗控制 681
24.2.2 分配器件模型 686
24.3 仿真差分对 691
24.3.1 提取差分对拓扑 691
24.3.2 分析差分对网络 694
24.4 差分对约束 705
24.4.1 设置差分对约束 705
24.4.2 应用差分对约束 706
24.5 差分对布线 708
24.6 后布线分析 711
习题 715
附录A User Preferences设置 717
附录B DRC错误代码 735
B.1 单一字符的错误代码 735
B.2 双字符的错误代码 736
参考文献 739