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第一章 逻辑代数和逻辑门电路 1

1．1 数制与编码 1

1．1．1 数制 1

1．1．2 编码 6

1．2 基本逻辑运算 10

1．2．1 与、或、非运算 11

1．2．2 与非、或非运算 13

1．2．3 异或、同或逻辑运算 14

1．2．4 正逻辑和负逻辑 16

1．3 逻辑代数的基本规律 17

1．3．1 逻辑代数的基本定律 17

1．3．2 逻辑代数的三个规则 19

1．4 逻辑函数的化简 20

1．4．1 逻辑函数的代数法化简 20

1．4．2 逻辑函数的卡诺图法化简 22

1．5 逻辑门电路 34

1．5．1 基本逻辑门 34

1．5．2 CMOS和TTL器件的外部特性 38

1．5．3 集电极开路的与非门 44

1．5．4 三态输出门 45

1．5．5 发射极耦合逻辑门和集成注入逻辑门 46

1．6 逻辑门电路的非逻辑应用 48

1．6．1 用逻辑门产生脉冲信号 48

1．6．2 用逻辑门组成单稳态电路 50

1．6．3 逻辑门电路的其他应用 51

习题一 53

第二章 组合逻辑电路 59

2．1 组合逻辑电路的分析与设计 59

2．2 组合电路的竞争与冒险 66

2．3 编码器与译码器 70

2．3．1 编码器 70

2．3．2 译码和译码器 76

2．4 比较器和加法器 83

2．4．1 比较器 84

2．4．2 加法器 87

2．5 数据选择器和奇偶校验器 91

2．5．1 数据选择器 91

2．5．2 奇偶校验器 96

2．6 利用组合逻辑器件设计逻辑电路 100

习题二 102

第三章 时序逻辑电路 107

3．1 概述 107

3．2 存储器件——触发器 108

3．2．1 基本RS触发器 108

3．2．2 时钟脉冲RS触发器 112

3．2．3 主从式JK触发器 115

3．2．4 集成主从式JK触发器 119

3．2．5 维持阻塞式D触发器 121

3．2．6 TTL集成触发器的主要参数 123

3．2．7 CMOS触发器 124

3．3 同步时序电路分析 127

3．4 同步时序电路设计 131

3．4．1 同步时序电路的设计步骤 131

3．4．2 设计举例 131

3．5 异步时序逻辑电路分析 140

3．5．1 脉冲型异步时序电路的分析 140

3．5．2 电平型异步时序逻辑电路的分析 143

3．6 寄存器和移位寄存器 145

3．6．1 寄存器和锁存器 146

3．6．2 移位寄存器 149

3．6．3 应用举例 152

3．7 计数器 155

3．8 应用中规模逻辑器件设计数字系统 170

习题三 175

第四章 数模和模数转换 182

4．1 数模转换电路 182

4．1．1 数模转换的基本工作原理 182

4．1．2 二进制权电阻D／A转换器 183

4．1．3 R-2R型D／A转换器 184

4．1．4 权电流D／A转换器 186

4．1．5 D／A转换器的主要性能参数 187

4．2 集成D／A转换器 189

4．3 模数转换电路 195

4．3．1 采样与保持 195

4．3．2 量化与编码 197

4．3．3 几种典型的A／D转换器 198

4．4 集成A／D转换器 203

习题四 209

第五章 脉冲电路基础 212

5．1 脉冲的基本知识 212

5．1．1 脉冲波形与参数 212

5．1．2 RC电路的暂态过程 214

5．2 简单脉冲波形变换电路 215

5．2．1 耦合电路 215

5．2．2 微分电路 216

5．2．3 积分电路 216

5．2．4 RC分压电路 217

5．2．5 限幅电路 217

5．2．6 钳位电路 219

5．3 集成脉冲电路 220

5．3．1 集成单稳态触发器 220

5．3．2 集成时基电路555 223

习题五 228

第六章 可编程逻辑器件基础 230

6．1 PLD器件基础 230

6．1．1 PLD器件概述 230

6．1．2 PLD器件的分类 232

6．2 可编程逻辑器件的基本结构 235

6．2．1 PAL的基本电路结构 235

6．2．2 GAL的基本电路结构 238

6．2．3 FPGA的基本电路结构 246

6．3 可编程逻辑器件产品简介 252

6．4 MACH系列器件介绍 256

6．4．1 MACH系列器件概述 257

6．4．2 ispMACHTM4A系列器件结构和配置 259

习题六 269

第七章 ispLSI应用软件 271

7．1 ABEL HDL语言 271

7．1．1 ABEL_HDL语言的基本要素 271

7．1．2 ABEL_HDL语言的基本语法 283

7．1．3 ABEL_HDL语言的指示字 293

7．2 ABEL_ HDL设计应用实例 299

7．3 可编程器件工具软件介绍 308

7．3．1 ispLEVER的原理图输入 309

7．3．2 设计的编译与仿真 314

7．3．3 建立元件符号（Symbol） 321

7．3．4 ABEL语言和原理图混合输入 322

7．3．5 把设计适配到Lattice器件中 327

7．3．6 在系统编程的操作方法 328

7．3．7 器件读出与加密实验 331

7．4 可编程器件工具软件应用实例 332

习题七 352

第八章 Verilog HDL设计方法 356

8．1 概述 356

8．2 Verilog硬件描述语言 357

8．2．1 Verilog HDL语言的基本结构 357

8．2．2 Verilog HDL语言的基本要素 360

8．2．3 Verilog HDL语言的基本语法 367

8．2．4 Verilog HDL语言的任务和函数结构 375

8．3 用Verilog HDL设计数字电路举例 377

8．3．1 简单的组合逻辑电路模块设计 377

8．3．2 简单的时序逻辑电路模块的设计 379

8．3．3 利用有限状态机进行较复杂时序逻辑电路的设计 382

习题八 386

第九章 数字系统设计基础 388

9．1 数字系统设计概述 388

9．1．1 数字系统的基本组成 388

9．1．2 数字系统的设计方法 389

9．1．3 现代数字系统的设计流程 390

9．2 ASM图和MDS图描述方法 392

9．2．1 ASM图 392

9．2．2 MDS图 398

9．2．3 ASM图转换MDS图 402

9．3 状态机设计与举例 405

9．3．1 状态机的基本结构和功能 405

9．3．2 状态机设计举例 406

习题九 413

参考文献 414